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Übungen zu Digitaler Schaltungsentwurf mit VHDL (ÜVHDL-RA)

Dozentinnen/Dozenten

Dipl.-Inf. Marc Reichenbach, Christian Hartmann, M. Sc.

Angaben

Übung
2 SWS, Sprache Deutsch
Zeit und Ort: Fr 12:15 - 13:45, 02.153

Studienfächer / Studienrichtungen

WPF INF-BA-V-RA 4-6 (ECTS-Credits: 2,5)
WF IuK-BA ab 5 (ECTS-Credits: 2,5)

Inhalt

Vertiefung der theoretischen Inhalte der Vorlesung
Schrittweiser Aufbau einer Grafik-Render-Einheit zur Darstellung von 3D-Objekten
Implementierung und Test auf FPGA-Board mit angeschlossenem VGA-Monitor

Zusätzliche Informationen

Erwartete Teilnehmerzahl: 16

Zugeordnet zu: Digitaler Schaltungsentwurf mit VHDL

Verwendung in folgenden UnivIS-Modulen

Institution: Lehrstuhl für Informatik 3 (Rechnerarchitektur)



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